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如何在FPGA中使用Verilog语言实现两个双向数据端口的读写操作?

发布时间:2019-06-07 06:59 来源:未知 编辑:admin

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  然后一般都是DSP主动操作,FPGA没法主动往DSP里送数据,就算你送到总线上了,DSP也不知道要去读,所以还是要例化一个RAM,单双口皆可,把数据存里面等 DSP 主动来读的

  其实选个verilog的教材看看比较好,FPGA与DSP的读写还要看相关的时序。再有FPGA内部不要出现三态端口的选择,先把数据选好后,再与端口连接。读写都一样。

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